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实际上,仿眞真与测试是不可分的,拿IBIS模型为例,通常我们称之为“行为级模型”,此类仿眞真模型也是通过芯片不同工作条件下的V、I测试曲线建立的,专业高速pcb设计外包公司,这就存在一个问题,仿眞真时如果不关注选取哪种工作条件下的芯片模型,就会仿眞真不准,例如:Slow、Typical、Fast。
从上面的例子可以看出,“仿眞真模型库”对于仿眞真结果至关重要,必须通过实际产品项目的仿眞真测试实际对比、修正后的仿眞真模型才能算作“准确的仿眞真模型”。
初次接觸高速訊号或DDR設計的人,专业高速pcb设计仿眞,可以找到一些在談走线繞等長的 舊資料(當中不乏過去大廠的design guide),但近幾年一些DDRII(或更快)的design rule,专业高难度高速pcb设计,漸漸改以定義setup time,贵州高速pcb设计, hold time budget with jitter取代length-matching routing rule,並且改以強調對時序圖的理解與使用模擬(margin predict)的重要性。簡单說:rule就是不管你怎麼layout設計,但你時序要滿足規格(timing margin),或傳輸线的損耗要在規格內(S-parameter)。